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jinyi https://forum.ytmicro.com/topic/1333/me05-mcal2-2-0-禁用jtag-a-b-swap功能测试?_=1779343529081

IPC是用来选择外设模块的时钟源，改变slow bus和IPC没直接关系，只有当外设被配置成slow bus才会有影响

image.png 如果外部晶振是16M的话，总线时钟至少要大于32M。同理外部晶振是40M的话，总线时钟至少要大于80M，因此当你分频为50M时，ETMR是没法正常工作的

dym 能连上jlink就可以，F4，erase chip

所有端口都有钳位的。
当然R27002可以起到限流作用，建议增加转专门的限流电阻。
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补充确认一下：这个方案是可行的。ME0 的 SPI SVD 里，SPIx->CTRL 提供 TXDMAEN/RXDMAEN，发送 FIFO 低于 watermark 或 buffer empty 时可以触发 TX DMA，接收 FIFO 高于 watermark 或 buffer full 时可以触发 RX DMA。因此要保持 SCK 连续，关键是让下一段 DMA 在 TX FIFO 消耗完之前重新装载/启动。

使用时建议注意：

发送块长度尽量放大，减少 DMA 完成中断频率。 DMA 完成回调里只做源/目的地址、TriggerCount 和 StartChannel 等最少操作，避免日志、复杂判断或耗时调用。 40 MHz 功能时钟下做 10 MHz SPI 时钟是合理的；如果实测仍有空隙，可以优先调大单次传输长度或降低 FIFO watermark，确认 DMA 重装载时间小于 FIFO 剩余数据发送时间。 需要收发环回时，SIN/SOUT 短接的方式可以用于验证 RX DMA 是否同步搬运。

Llllll 在 串口DMA 中说：

Frank 大佬好，想问一下LinFlexD不支持DMA+串口空闲中断，那MD2的Uart支持么

支持

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https://forum.ytmicro.com/topic/530/win10-打开mcal工程报-worker-terminated?_=1774332563156 看看这个帖子对你有没有帮助

1.确认一下Platform中配置的Adc中断服务程序的优先级，Adc中断优先级建议配置成2-7，
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2.不要在你的Adc转换完成notification中调用Adc_ReadGroup()读取结果，建议在任务中周期性读取结果。