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1 为什么高低切换才有问题: ADC模块是基于SarADC实现的,是双阻容阵列,高低各用一组阵列。即低通道、高通道,芯片ADC在高低阵列切换时存在设计缺陷,即芯片ERRATA E600002描述;用户在使用中需要进行规避;
2 为什么减小端口的电阻和电容,或者软件修改采样时间,都不能解决这个问题呢? 加大采样时间,可以一定程度上改善但无法根本解决该问题。
3 为什么ADC0没有问题? ADC0 ADC1设计原理上都存在此问题,
解决方法: 通过软件规避,避免高低切换ADC通道;
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